【IC前端虚拟项目】spyglass lint环境组织与lint清理

spyglass lint

RTL代码在交付给验证同时进行功能验证时，可以同步进行lint的清理工作。一般而言影响编译和仿真的问题会在vcs的error和warning中被修正，因此清理lint的过程可以与功能验证同步进行。

Spyglass可以用于检查混合设计中的语言互操作性和一致性问题。对于设计中包含多种硬件描述语言的情况，Spyglass 能够识别并解析其中的模块及其互连，并对其进行验证。例如，在包含 Verilog 和 VHDL 的混合设计中，Spyglass 会自动识别并解析 Verilog 和 VHDL 文件及其相互连接。通过运行 Spyglass Lint 功能，可以检查混合设计中的语言一致性问题，例如不兼容的数据类型、互操作性问题以及其他可能导致设计故障或不一致的问题。

快速上手spyglass

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本文记录了使用Synopsys Spyglass工具进行RTL代码验证的过程。首先介绍了如何通过GUI界面添加文件、设置顶层模块并保存工程。详细说明了编译步骤及常见问题解决方法，如.sv文件解析和头文件路径设置。重点演示了Lint检查流程，包括结果查看和报告分析，并介绍了Waiver机制的使用方法。此外，还讲解了CDC检查所需的sgdc约束文件配置。最后提供了常用命令行操作，包括编译和运行特定检查目标的方法。文章为数字IC设计人员提供了Spyglass工具的基本使用指南。

总结spyglass使用过程中出现的问题，总结使用步骤供参考，实践出真知，解决问题就是好方法。

在本练习中，我们将分析lint目标运行期间产生的违规。我们可以在SpyGlass GUI中使用各种调试工具来理解违规，在RTL代码中调试其根本原因，并查看如何在SpyGlass环境本身中修复这些违规。同时在运行Goal**同时会生成多个报告，不同报告提供不同信息，可在Report》More Report下查看。在GUI底部的Violations可查看违规信息。在显示出违规信息后，点击违规信息窗口顶部的Group By，然后选择Goal by Rule。此字段确定批处理运行中的违规在消息树中的排序方式。

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SPYGLASS初步使用教程 文字目录SPYGLASS初步使用教程1.整体实验文件预览1.1 RTL框图1.2 实验目录结构2.实验一2.1 读取设计文件2.2 设置顶层模块2.3 编译设计，得到结果2.4 静态分析2.5 实验一总结3.实验二4.实验三5.实验四5.1 **W415**错误5.2 SYNTH_5159警告5.3 UndrivenInTerm-ML错误5.4 Waiving 违规6.生成结果报表最终结束语 ​ SPYGLASS是很高效的RTL分析和CDC检查工具，可以有效的帮助规避设计

目录 1.命令解释 1.1 以上的几类命令 1.1.1 set_option 1.1.2 current_methodology 1.1.3 current_goal 1.1.4 read_file 1.1.5 set_goal_option 1.1.6 set_parameter 对于以上命令的解释需要逐步更新，有些命令一看便知功能不再赘述。这些配置可以在使用spyglas...

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之后点击“Read Design”，再在左侧点击“Run Design Read”开始进行设计文件编译和分析，在读取完成后会在下方窗口列出问题。如果需要修改代码，可以在代码窗口中点击有问题的代码行，使得光标落于该行，然后点击e即可将打开默认的编辑器进行代码编辑。错误信息以红色显示，警告以橙色显示，信息以绿色显示。在窗口上方中间点击Goal Setup ，然后在主窗口区勾选Lint_rtl（在lint中点击+即可见），如下图。左侧选择文件后点击中间的“Add”即可完成文件的添加，点击“OK”退出当前窗口。

SpyGlass主要有五个功能： 一款针对verilog的工具 1.lint检查 2.CDC检查：跨时钟域检查 3.LowPower 4.约束Constraint检查 5.DFT检查 1.lint检查 检查verilog代码的语法和可综合性 2.CDC检查：跨时钟域检查 识别各种FIFO和握手信号 3.LowPower 在未进行DC和PR之前对verilog进行功耗分析 4.约束Constraint检查 验证SDC文件的正确性 5.DFT检查 测试ATPG的覆盖率分析 ...

数字电路设计的流程里面有两个”不起眼“的步骤，LINT和CDC。 其中LINT尤其没有存在感。LINT和CDC其实是两个不同的东西，但是从功能上他们有时候会指向相同的问题，也就是说有重叠的部分，所以经常会放在一起做。在candence的工具里面，LINT/CDC是放在LEC这个大工具下面，而在synopsis的工具里面，是放在spyglass下面。 LINT 英文里LINT是线头，起这个名字的人大概是把芯片设计类比成衣服的制造——我们知道，线头的多少通常是衣服质量好坏的直观反映，所以做衣服有个一步骤就是剪线

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预综合过程主要由VC SpyGlass Lint中集成的VC Static Platform完成。 准备文件： 待综合的.v文件（top.v） 步骤： 设置环境变量$VC_STATIC_HOME 如下 setenv VC_STATIC_HOME <installation_directory> set path = ($VC_STATIC_HOME/bin $path) 以命令行方式启动软件 % $VC_STATIC_HOME/bin/vc_static_shell 在命令行窗口中