Vivado IP核：AXI Uartlite的使用经验分享

最新推荐文章于 2026-06-29 21:17:31 发布
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本文分享了Vivado中AXI Uartlite IP核的配置与使用经验，包括IP的基本设置、时序特点分析，如Rx/Tx FIFO、Control/Status Register，并通过仿真实例展示了AXI-Lite接口的时序操作，强调了_wstrb信号在该IP中的作用。此外，还提到了中断功能的使用以及测试bench的创建。
1. IP基本设置

在Vivado中，打开IP Catalog，搜索“uart”：
在这里插入图片描述
双击“AXI Uartlite”，进入IP配置界面：
在这里插入图片描述
这里可以配置IP的具体参数，设置时钟频率、波特率等，完成后，生成IP即可。

2. IP的时序特点

点击下面的链接可以下载该IP核的官方指导文档：
https://china.xilinx.com/support/documentation/ip_documentation/axi_uartlite/v2_0/pg142-axi-uartlite.pdf

打开Vivado生成的IP文件（axi_uartlite_0_stub.v），可以看到这个IP的接口：
在这里插入图片描述
这个IP是基于AXI-Lite协议的（从IP命名也可以看出来）。可以发现，AXI-Lite的读/写通道，地址的位宽只有4bits，读/写数据的具体地址是如何分配的？阅读官方的指导文档可以找到答案：

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