Vivado2019.1 下BITSTREAM CONFIG SPI_BUSWIDTH 设置笔记

最新推荐文章于 2026-05-09 05:41:28 发布
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本文介绍在Vivado2019.1环境下配置Artix7 FPGA使用SPIx4的方法。提供了两种设置SPI总线宽度为4的具体步骤：一种是在XDC约束文件中设置属性；另一种是在完成实现后通过Project Manager手动调整。

vivado2019.1下

由于开发artix 7时需要使用SPIx4进行配置FPGA时，故作此记录。

方法1：

使用原语法，

在Language Template中查看XDC部分的例句：
set_property BITSTREAM.CONFIG.SPI_BUSWIDTH 4 [current_design]

复制此语句到工程使用的xdc约束文件中即可。

 

方法2：

需要在完成Implementation 后，在Project Manager下点击setting，跳出

点击蓝色字：Configure additional bitstream setting:

修改Bus width即可。
      
    

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