xilink(fpga)的ise使用

这篇博客详细介绍了如何使用Xilinx ISE进行Verilog设计,从新建工程、编写ADDER模块,到查看RTL原理图、进行仿真检查,直至生成bit文件并下载到FPGA板子上。过程中包括代码编写、仿真验证、引脚约束及编程等关键步骤。

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Ise使用方法

C=a+b

1:打开软件,点击file>> new project

2:建立一个新的工程,工程名为test >> next

 

3:设置FPGA信息,这里使用的是FPGA kintex7系列的xc7k325T.封装是FFG900,速度是-2,仿真工具选用ISE自带的ISIM,语言选verilog >> next.

 

4:这里是总结界面,点击finish。

 

5:选中xc7k325t-2ffg900,左键 >> new soure (design窗口下的implementation).

 

6:选择 Verilog module,file name 中输入文件名ADDER.

 

7,点击next。

 

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