FPGA——XILINX原语（1）

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本文详细介绍了XilinxFPGA中的时钟组件（如BUFG、BUFH、BUFR和BUFIO）以及IO端口组件（IDDR、ODDR和IDELAY），包括它们的使用场景和功能特性，重点讲解了IDDR和ODDR的双沿采样模式。

FPGA——XILINX原语（1）

1.时钟组件

时钟结构
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（1）BUFG

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输入输出

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（2）BUFH

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输入输出

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（3）BUFR

可以进行分频，就不用进入PLL了

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输入输出
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（4）BUFIO

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输入输出
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（5）使用场景

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2.IO端口组件

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HR是3 HP是2
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（1）IDDR

其中 ILOGICE3的结构
在这里插入图片描述

其中
IDDR：输入数据的双沿采样，是ILOGIC块中专用的寄存器，用于实现输入数据双沿采样。

IDDR工作模式：
OPPOSITE_EDGE mode ；
SAME_EDGE mode ；
SAME_EDGE_PIPELINED mode；

常用的模式为 SAME_EDGE_PIPELINED mode
在这里插入图片描述
原语
在这里插入图片描述

（2）ODDR

ODDR ：输出数据的双沿采样，是OLOGIC块中专用的寄存器，用于实现输出数据双沿采样
在这里插入图片描述
ODDR工作模式：
OPPOSITE_EDGE mode ；
SAME_EDGE mode ；

常用 SAME_EDGE mode ；
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原语
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（3）IDELAY

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浅谈XILINX FPGA CLB单元 之 分布式RAM (Distributed RAM Available in SLICEM Only、RAM128X1D、Verilog原语描述)
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