【FPGA教程案例71】基础操作1——Xilinx原语学习及应用1

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#fpga开发 #学习 #xilinx原语 #BUFG
本文介绍了Xilinx原语的基础知识，特别是BUFG全局时钟缓冲器的使用。通过Vivado软件，展示了如何例化和测试BUFG原语，说明了其在FPGA设计中确保时钟信号低延迟和低抖动的关键作用。

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目录

1.软件版本

2.原语概述

3.原语的初步编写

4.原语的功能进行测试

1.软件版本

vivado2019.2

2.原语概述

       原语(Primitive)，是Xilinx针对其器件特征开发的一系列常用模块的名字，是芯片中的基本元件，我们可以视作xilinx对其元器件开发的特定的库函数供用户调用。其使用方法和verilog HDL相似，直接按模块进行例化就可以使用。Xilinx公司提供的原语，涵盖了FPGA开发的常用领域，包括：计算组件、I/O端口组件、寄存器和锁存器、时钟组件、处理器组件、移位寄存器、配置和检测组件、RAM/ROM组件、Slice/CLB组件以及G比特收发器组件。

3.原语的初步编写

      我们打开vivado软件，点击如下的菜单：

点击后可以看到：

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