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【Xilinx FPGA】 [DRC PDRC-179] MMCM_adv_ClkFrequency_div_no_dclk 错误解决
在UltraScale+系列板卡上使用MMCME4_ADV原语时，出现如下错误。使用MMCME4_ADV原语自己的需求是，输入100MHz时钟，然后经过MMCME4_ADV原语输出250MHz频率时钟。
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