英文原版数据中对Arm cache的操作flush（invalidate），clean的描述

将 cache中的内容写入下一级cache或者memory中，只有被指的cache被影响，比如。这条命令会将Cahce中的 dirty 行给写入下一级cache中或者是memory中。这时只有 ICache 被影响，其它cache则不受影响。将 Cache 中的内容和 memory中的内容进行比较。如果当前CPU不支持cache，使用上面命令时会报出。这条命令将会 invalidate 整个 cache.将cache中的内容保存到指定文件中。，所有内容都会被dump出来。显示所以被缓存的变量。

背景 嵌入式开发中遇到问题：将SD卡中某个文件读取到一块内存中，再将该内存地址发送给外设硬件，硬件通过该地址读取数据做处理，处理结果异常，并且现象有以下规律： 通过代码实现将SD卡中的文件数据拷贝到新文件中，文件是正常的。 外设硬件处理前，先使用代码使用一次该块内存，即使是简单的打印，处理结果也是正常的。 问题分析 从问题现象很容易会想到和缓存有关，但是应用层/OS创建的DDR缓存还是cpu L1/L2/L3 cache需要确认下，最终该问题测试验证是cpu cache导致的。 嵌入式开发中，cp

系统缓存组(SCG)是Arm多核处理器中优化内存访问的关键技术，通过逻辑区域划分和路由策略实现高效数据共享。其核心原理包括哈希/非哈希内存区域配置，涉及基地址对齐、尺寸编码等寄存器设置，直接影响内存访问延迟和缓存一致性。在AI推理等场景中，CXRA类型节点能显著减少协议转换开销。工程实践中需注意安全访问约束和多区域配置策略，通过CoreSight等调试工具可实时监控路由路径。合理配置SCG寄存器对构建高性能内存系统至关重要，特别是在多芯片互联等异构计算场景中。

2、DMA传输要注意与cache的一致性问题。必须保证DMA缓冲区中的数据时最新的。有两种方法：cache flush和cache invalidate。1、网卡等外设的DMA传输，要求缓冲区的物理地址必须连续。因为DMA硬件时直接和内存进行数据传输。1、只把更新的cache区标记为dirty，并不同步写入memory。2、只在cache区要更新新的数据时，才会更新memory。

Linux：Cache之 Cache Invalidate和Cache Flush

清除flush cache的意思是清除cache中存储的全部数据。对处理器而言，清除操作只要清零相应cache行的有效位即可。当存储器配置上有变化时，整体或部分cache可能需要进行清除操作。有时也用术语作废（invalidate）来代替术语“清除”。然而，对于采用写回策略的D-cache，就需要使用清理（clean）操作。     清理clean cache的意思是把脏的（即被改写过的）cac

clean： 将cache里面的新内容写入到ddrinvalidate： 将cache里面的内容无效掉，即丢掉虽然都说刷cache，实际可能是上面两类动作的一种或者组合例如：如果刷指令cache，因为指令是只读的，直接invalidate即可。如果刷数据cache，如果明确可以直接丢掉数据则可以直接使用invalidate；通常的刷数据cache需要先clean再invalidate;当然数据cache也可以只clean不invalidate。

用某ARM芯片做硬件逻辑解压缩，从其开源的Uboot里取出解压缩代码，拿到LiteOS里面使用。 先从Flash读取压缩文件到内存， 申请一块足够大的目标Buffer， 将两块内存交给解压硬件逻辑，有低概率解失败； 。。。 在读取flash上的压缩数据到内存后，将这段存放压缩数据的内存进行clean cache操作，没有复现此问题。 原因应该是解压缩逻辑没有使用Cache里的内容， ...

处理器的cr0寄存器Pcd标志用来启用或者禁用高速缓存电路。 pcd标志是访问叶匡中的数据时高速缓存是否开启，pwt表示将数据写到叶匡的时候采用的回写策略是通写还是回写。 TLB用于缓存刚刚被访问的物理地址。每个cpu都有一个TLB。 常用宏功能： PAGE_SHIFT:指定offset字段的位数，页框大小。 PMD_SHIFT指定线性地址的offset字段与table字段的总位数。32位当PAE被禁用的时候是22位offset（12）+table（10），PMD_MAS...

BTB——用于记录一条分支指令的跳转地址，由于这儿存储的是指令地址，例如32位地址，因此，这个表格就不能做到存储BHT那样多的内容了，如果也支持4K条指令，则需要128Kbit的存储空间，这几乎可以赶上一个L1Cache的容量了，所以BTB一般很小，就32项或者64项。如图所示，一种二级自适应预测器可以记住过去n次执行该指令时的分支情况的历史，可能的2n种历史模式的每一种都有1个专用的饱和计数器，用来表示如果刚刚过去的n次执行历史是此种情况，那么根据这个饱和计数器应该预测为跳转还是不跳转。

这里说的内存，主要是指主存。它的读写速度虽然比磁盘快很多。但是相对于CPU的速度依旧还是慢。为加快cpu访问内存的速度，CPU和主存储器之前都会增加一级乃至三级高速缓存，cpu访问cache时，如果能到找到匹配的地址，会直接从缓存中取数据或将写入数据，而无需访问主存。.........

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转自：刷cache的3种操作：clean/invalid/flush_小葫芦写代码的博客-CSDN博客_cache flushcache line cache被平均分成了多个cache line。 cache line是cache和DDR之间数据传输的最小单位。 什么意思呢？当CPU试图load一个字节数据的时候，如果cache miss，那么cache控制器会从主存中一次性的load cache line大小的数据到cache中。 例如，ca

刷新缓存（Flush）和失效缓存（Invalidate）

在计算机系统中，CPU缓存（Cache）是提高内存访问速度的关键组件。但缓存与主存数据不一致的问题会导致程序运行异常，因此需要有效的缓存同步机制。本文将深入解析两种核心缓存操作——**invalidate（失效）** 和**flush（刷新）**，通过场景对比、实现原理和内核实例，帮助读者理解它们的适用场景和底层差异。 ## 缓存不一致的根源 CPU缓存的物理特性决定了数据同步的复杂性。当多个...

在ARM架构中，L1 cache都是VIPT的，也就是当有一个虚拟地址送进来，MMU在开始进行地址翻译的时候，Virtual Index就可以去L1 cache中查询了，MMU查询和L1 cache的index查询是同时进行的。如果将block的内存属性配置成 non-shareable, 那么core0访问该内存时，数据缓存的到Core0的L1 D-cache / L2 cache （将L1/L2看做一个整体，直接说数据会缓存到core0的private cache更好），不会缓存到其它cache中。