通信算法之323:verilog中带参数实体模版

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一.例化带参数模块

提示:参考模版

    che_h
    #(
        .ANT_NUM (16),         //CHE
        .IQ_WIDTH (32),        //IQ data width 
        .AGC_WIDTH (8)         //AGC factor width
    )
    u_che_h(
        .clk  ( clk )  ,  
        .rst  ( rst)  ,   
        。。。。
      );

二.带参实体

提示:参考模版

module che_h #(
   parameter ANT_NUM		       = 16,                    //CHE
   parameter IQ_WIDTH              = 32,                    //IQ data width 
   parameter AGC_WIDTH             = 8                      //AGC factor width                                   
)                                                                       
(                                    
    input                          clk,
    input                          rst,                                         
    //。。。。。。。。。。。。。。。。。。                            
    output reg                     freq_ofst_wen,
    output reg   [15:0]            freq_ofst_wdata   
    );

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