【FPGA教程案例68】硬件开发板调试8——通过ila在线调试DDS信号发生器

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本课程成果预览(通过ila在线监测正弦信号)

目录

1.软件版本

2.项目工程准备

2.1 更新芯片型号

2.2 加ila

2.3 加约束

3.verilog程序修改

4.DDS硬件测试

1.软件版本

vivado2019.2

2.项目工程准备

        ILA（Integrated Logic Analyzer）是在线逻辑分析仪，它的工作原理是借用了传统逻辑分析仪的理念以及大部分的功能，并利用FPGA中的逻辑资源，将这些功能植入到FPGA的设计当中。ILA是以IP核的形式实现的。在线逻辑分析仪通过一个或多个探针（Probe）来采集希望观察的信号，然后通过片内的JTAG硬核组件，将捕获到的数据传送给下载器，进而上传到Vivado IDE以供用户查看。Vivado IDE也能够按照上述数据路径，反向地向FPGA中的在线逻辑分析仪传送一些控制信号。

       本课程，我们主要选择之前课程学习过的经典案例DDS发生器，来结合ila进行FPGA开发板调试。首先我们回顾下DDS的课程内容：