ModelSim10.6安装与Vivado2018.3的关联(转载)

本文详细介绍了如何安装ModelSim10.6,破解步骤,以及如何将Vivado2018.3与ModelSim关联进行仿真,包括从ModelSim切换回Vivado仿真。适合FPGA开发者进行学习和实践。

目录

一、ModelSim10.6安装

二、破解

三、Vivado2018.3关联

四、从ModelSim仿真切换回vivado仿真


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一、ModelSim10.6安装

1、打开存放安装包的文件夹,找到modelsim-win64-10.6d-se.exe文件,右键选择“以管理员身份运行”,点击“下一步”;

2、输入安装路径,如D:\FPGATools\modeltech64_10.6d,点击“下一步”;

3、创建目录,点击“”;

4、点击“同意”;

5、开始安装ModelSim SE-64 10.6d软件;

6、软件安装过程中会出现一些提示,点击“”;

7、点击“”;

8、点击“完成”,完成软件安装。

二、破解

        1、和谐工具分32位和64位。具体使用哪个和谐工具,要看你安装的modelsim是哪个版本。比如quartus13.0软件带的altera定制版的10.1就是32位版,就要用32位版和谐工具,如果是modelsim-se-10.6d,就是64位版,就要用64位版和谐工具。

        具体应该用哪个,还可以看安装后modelsim.exe所在文件夹下是有mgls.dll还是mgls64.dll,如果是mgls.dll用32位版工具,如果是mgls64.dll则使用64位版工具。

        根据你要和谐的软件版本,拷贝对应的和谐文件(patch_dll_xxx.bat和MentorKG_xxx.exe)到安装后modelsim.exe所在的文件夹,如果是要和谐modelsim-se,则路径类似为D:\FPGATools\modeltech64_10.xx\win64,比如笔者装的10.6d,在D:\FPGATools\modeltech64_10.6d\win64。
        如果你是要和谐altera定制版,则路径应该类似D:\altera\13.0\modelsim_ae\win32aloem,具体以你电脑上的软件安装后位置为准,反正modelsim.exe这个文件在哪里,和谐文件就拷贝了放到哪里。

        2、运行patch_dll_x32.bat或patch_dll_x64.bat文件;

        3、等待破解工具进行破解。破解过程应该持续几秒到十几秒,如果只是一闪而过(1秒内),那肯定就是破解工具的32和64位选错了,具体可以查看mgls.dll或mgls64.dll的修改日期,如果是今天的,那就是破解成功了。

        4、破解完成后会生成一个LICENSE.TXT文件并用文本编辑软件打开,该文件默认存放在C:\Users\xiaomeige\AppData\Local\Temp路径下,其中xiaomeige需要换成你自己电脑的用户名。这个位置很不好找,所以我们可以直接将打开的文件另存为,以存放到一个已知且不容易丢失的位置,比如modelsim软件的安装目录下(如D:\FPGATools\modeltech64_10.6d下)。

资源下载链接为: https://pan.quark.cn/s/1bfadf00ae14 Modelsim10.6c是由美国Mentor Graphics公司开发的一款在FPGA设计领域具有极高地位的仿真软件,属于电子设计自动化(EDA)范畴,对FPGA设计流程有着极为关键的作用。借助它,工程师们能在硬件实现前完成功能验证和性能评估,有效提升设计的精准度效率。 Modelsim的特性优势如下:一是支持多种硬件描述语言,像VHDL、Verilog以及SystemVerilog等主流语言都能兼容,可应对复杂数字电路设计;二是拥有高性能仿真引擎,能快速进行大规模电路仿真,缩减设计周期;三是调试工具强大,波形查看器、代码断点、数据观察点等一应俱全,便于故障定位和问题解决;四是运用并行仿真技术,借助多核处理器并行处理能力,加速仿真进程,提高仿真速度;五是提供集成环境,将编译、仿真、调试等功能集于一体,简化工作流程。 Modelsim10.6c版本特点包括:一是稳定性增强,相比早期版本,优化了稳定性,降低仿真过程中的错误和崩溃几率;二是兼容性提升,支持Xilinx、Intel(原Altera)等更多FPGA厂商,且兼容Windows和Linux等多种操作系统;三是性能改进,在仿真速度和内存管理上优化,使处理大型设计更流畅;四是添加新功能,可能涵盖对新硬件描述语言特性的支持和用户界面改进,以提升用户体验。 使用Modelsim10.6c进行FPGA设计一般要经历以下步骤:一是编写和编译代码,用VHDL或Verilog等语言编写FPGA设计代码,再利用Modelsim编译工具将其变为可执行仿真模型;二是设置仿真环境,配置时间步长、初始值等仿真参数,以适应特定测试需求;三是运行仿真,启动Modelsim进行仿真,观察分析时序图、波形图等仿真结果;四是调试优化,依据仿真结果调整设计,借助
代码转载自:https://pan.quark.cn/s/4782ea6cfe15 《Modelsim10.6Vivado2018的协同使用详解》Modelsim是一款具有高度能力的硬件描述语言(HDL)仿真器,在数字电路设计领域,尤其是FPGA和ASIC的设计验证方面得到广泛采纳。Vivado是由Xilinx公司推出的集成化设计套件,主要应用于FPGA和SoC的设计、实现以及调试过程。当将Modelsim10.6Vivado2018联合应用时,能够构建一个完整的硬件设计及验证环境。让我们深入探究Modelsim10.6。这款仿真器支持VHDL和Verilog这两种核心的HDL语言,可以对设计进行功能仿真、性能评估和时序分析。Modelsim10.6引入了多项改进特性,例如提升了仿真速度,强化了并行处理能力,以及提供了更为便捷的用户界面,使得设计者能够更高效地开展仿真工作。安装Modelsim10.6的过程非常直接,但需留意,为了保障Vivado2018的兼容性,必须获取Vivado版本相吻合的Modelsim版本。"modelsim安装包"内含了所有必需的文件,涵盖安装程序、许可证文件以及可能的补丁。在解压"modelsim10.6安装.zip"后,依照安装向导的步骤进行操作,务必在配置环节选择正确的安装路径和组件。接下来,我们探讨如何将Modelsim整合到Vivado2018中。Vivado2018提供了原生的IP核验证工具,然而,运用Modelsim进行高级功能和性能验证则更为灵活。在Vivado的项目配置中,能够设定外部仿真器为Modelsim,这样Vivado就能生成Modelsim相容的仿真指令和测试平台。在Vivado中,通过“I...
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