Makefile 文件中的:obj-$(CONFIG_TEST) += test.o,这一类的是什么意思?

博客介绍了Makefile中`obj-$(CONFIG_TEST)+=test.o`的用法。`$(CONFIG_TEST)`是一个变量,可以被设置为'y'或'm',分别对应编译到内核和编译成模块。根据`CONFIG_TEST`的值,`obj-$(CONFIG_TEST)`将变为`obj-y`或`obj-m`,从而决定`test.o`文件的编译目标。此配置常用于Linux内核构建系统中。

Makefile 文件中的:obj-$(CONFIG_TEST) += test.o,这一类的是什么意思?

obj-y 是编译到内核,obj-m是编译成模块,obj-$是什么?

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$(CONFIG_TEST) 是一个整体,$(xxx)表示引用变量 xxx

比如定义 CONFIG_TEST=y

 $(CONFIG_TEST)就是y

   obj-$(CONFIG_TEST) 就是 obj-y

    

  又比如定义 CONFIG_TEST=m

 $(CONFIG_TEST)就是m

   obj-$(CONFIG_TEST) 就是 obj-m

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